台积电规划1nm芯片制造工艺，计划到 2030 年实现 1 万亿晶体管的单个芯片封装

台积电规划1nm芯片制造工艺，计划到 2030 年实现 1 万亿晶体管的单个芯片封装 据 Tom's Hardware 报道，在本月举行的 IEDM 2023 会议上，台积电制定了提供包含 1 万亿个晶体管的芯片封装路线，这一计划与英特尔去年透露的规划类似。 当然，1 万亿晶体管是来自单个芯片封装上的 3D 封装小芯片集合，但台积电也在致力于开发单个芯片 2000 亿晶体管。 为了实现这一目标，该公司重申正在致力于 2nm 级 N2 和 N2P 生产节点，以及 1.4nm 级 A14 和 1nm 级 A10 制造工艺，预计将于 2030 年完成。 ，

台积电不用新一代EUV光刻机 2030年的1nm再说

台积电不用新一代EUV光刻机 2030年的1nm再说 Intel此前公布的路线图上，18A之后已经安排了三个新的制程节点，但尚未具体命名。基辛格透露其中一个相当于1.5nm工艺，预计命名为15A，将在德国工厂量产。台积电对于高NA EUV光刻机引入计划则一直守口如瓶，有多个消息来源称台积电还在观望评估，目前计划要等到1nm工艺节点才会上马，而时间要等到2030年左右了。台积电目前正在冲刺2nm工艺，预计2025-2027年间量产，单芯片可集成超过1000亿个晶体管，单个封装可超5000亿个。然后是1.4nm、1nm，其中后者计划2030年左右量产，将在单颗芯片内集成超过2000亿个晶体管，单个封装内则超过1万亿个，相比N2工艺翻一倍。有趣的是，Intel也计划在2030年做到单个封装1万亿个晶体管，可谓针锋相对。 ... PC版： 手机版：

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【业内人士：台积电获得多家芯片供应商的3nm订单承诺】台积电的 3nm 工艺仍将采用 FinFET 晶体管的结构，而三星的 3nm 节点采用GAA晶体管架构。三星甚至领先于台积电，将 3nm 工艺技术转向量产，但尚未吸引主要芯片供应商的订单。 #抽屉IT

【台积电放弃 N3 工艺？】按照台积电的规划， 3nm 节点内有四代制造工艺，逐代的性能、晶体管数和成熟度都有着提升。在放弃 N

【台积电放弃 N3 工艺？】按照台积电的规划， 3nm 节点内有四代制造工艺，逐代的性能、晶体管数和成熟度都有着提升。在放弃 N3，也就是第一代 3nm 工艺后，台积电也开始着手准备更具性价比和成熟度的 N3E 二代工艺。 #抽屉IT

【台积电首次公布2nm制程工艺，2025年量产】今天凌晨举行的台积电北美技术论坛上，台积电（TSMC）正式公布未来先进制程路线图

【台积电首次公布2nm制程工艺，2025年量产】今天凌晨举行的台积电北美技术论坛上，台积电（TSMC）正式公布未来先进制程路线图。其中，台积电3nm（N3）工艺将于2022年内量产，而台积电首度推出采用纳米片晶体管（GAAFET）架构的2nm（N2）制程工艺，将于2025年量产。 #抽屉IT